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本课程安排： 学时：48学时（课堂教学40学时，上机实验8学时） 一、传统设计方法：自下而上（Bottom - up)的设计方， 是以固定功能元件为基础，基于电路板的设计方法。 二、 EDA方法：自上而下（Top - Down)的设计方法。其方案验证与设计、系统逻辑综合、布局布线、性能仿真、器件编程等均由 EDA工具一体化完成。 三、传统方法与EDA方法比较： FPGA：Field Programmable Gates Array CPLD：Complex Programmable Logic Device 主流公司：Xilinx、Altera、Lattice FPGA/CPLD 显著优点： 开发周期短、投资风险小、产品上市速 度快、市场适应能力强、硬件修改升级方便。 CPLD/FPGA开发应用选择 VHDL：IEEE标准，系统级抽象描述能力较强。 Verilog: IEEE标准，门级开关电路描述能力 较强。 ABEL: 系统级抽象描述能力差，适合于门级 电路描述。 EDA开发工具分为： 集成化的开发系统: 特定功能的开发软件：综合软件 仿真软件 四、实验开发系统 一、设计输入子模块 用图形编辑器、文本编辑器作设计描述，完成语义正确性、语法规则的检查。二、设计数据库子模块 系统的库单元、用户的设计描述、中间设计结果。 四、仿真子模块 功能仿真：又称前仿真、系统级仿真或行为仿真，用于验证系统的功能。 时序仿真：又称后仿真、电路级仿真，用于验证系统的时序特性、系统性能。 仿真是系统验证的主要手段，是整个电子设计过程中花费时间最多的环节。五、布局布线子模块 完成由逻辑设计到物理实现的映射。xaw红软基地

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